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ISL97801
Pin Descriptions
PIN
1
2
3
4
5
NAME
VDC
VHI
OVP
SWD1
SWD2
DESCRIPTION
Internally regulated 5V supply, tracks V IN for input voltages less than 5V. LDO output can also be biased with
external supply if VIN is <5.5V. A minimum of 3.3μF decoupling capacitor is needed in this pin.
Power FET gate drive supply. Can be biased with external supply if Vin is <5.5V
Overvoltage monitor input; tie to VOUT for normal operation
NMOS power FET drain
NMOS power FET drain
6
BUCK/BOOSTN Tie to GND for BOOST operation and to VDC for Buck operation
7
8
9
10
11
12
13
14
15
16
17
18
19
20
LEVEL
TEMP
FB
TMAX
SWS2
SWS1
EN/PWM
MODE
ENL
VBAT
NC
GND
FAULT
VIN
Sets LED bias current level; VFB(nominal) = VLEVEL/5
Temperature reference, tie to GND to disable temperature compensation
LED current feedback
Maximum LED temperature set point; if TEMP voltage exceeds TMAX, FB set point will be reduced
NMOS power FET source
NMOS power FET source
Chip enable and light modulation PWM dimming input
Digital Input; tie to GND to set FB reference to 400mV, tie to VDC to control FB reference with LEVEL input
LED load isolation MOS gate driver
Input supply monitor
Leave floating (internally connected)
Ground return and FB ground reference
Gate drive of fault protection FET. Driven low under fault conditions
Input supply
9
FN6428.1
April 2, 2007
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